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参数资料
| 型号： | EVAL-ADUC7121QSPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 84/96页 |
| 文件大小： | 0K |
| 描述： | BOARD EVALUATION FOR ADUC7121 |
| 设计资源： | ADUC7121 Gerber Files ADUC7121 Schematic |
| 标准包装： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 类型： | MCU |
| 适用于相关产品： | ADUC7121 |
| 所含物品： | 板，CD |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页当前第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页
Data Sheet
ADuC7121
Rev. B | Page 85 of 96
Bit
Value
Name
Description
5:4
11
IRQ2SRC[1:0]
External IRQ2 triggers on falling edge.
10
External IRQ2 triggers on rising edge.
01
External IRQ2 triggers on low level.
00
External IRQ2 triggers on high level.
3:2
11
IRQ1SRC[1:0]
External IRQ1 triggers on falling edge.
10
External IRQ1 triggers on rising edge.
01
External IRQ1 triggers on low level.
00
External IRQ1 triggers on high level.
1:0
11
IRQ0SRC[1:0]
External IRQ0 triggers on falling edge.
10
External IRQ0 triggers on rising edge.
01
External IRQ0 triggers on low level.
00
External IRQ0 triggers on high level.
IRQCLRE Register
Name:
IRQCLRE
Address:
0xFFFF0038
Default value: 0x00000000
Access:
Read and write
Table 122. IRQCLRE MMR Bit Designations
Bit
Name
Description
31:25
Reserved
These bits are reserved and should not be
written to.
24
IRQ5CLRI
A 1 must be written to this bit in the IRQ5
interrupt service routine to clear an edge
triggered IRQ5 interrupt.
24
IRQ4CLRI
A 1 must be written to this bit in the IRQ4
interrupt service routine to clear an edge
triggered IRQ4 interrupt.
23
Reserved
This bit is reserved.
22
IRQ3CLRI
A 1 must be written to this bit in the IRQ3
interrupt service routine to clear an edge
triggered IRQ3 interrupt.
21
IRQ2CLRI
A 1 must be written to this bit in the IRQ2
interrupt service routine to clear an edge
triggered IRQ2 interrupt.
20
IRQ1CLRI
A 1 must be written to this bit in the IRQ1
interrupt service routine to clear an edge
triggered IRQ1 interrupt.
19
IRQ0CLRI
A 1 must be written to this bit in the IRQO
interrupt service routine to clear an edge
triggered IRQ0 interrupt.
18:0
Reserved
These bits are reserved and should not be
written to.
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PDF描述 |
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