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参数资料
| 型号： | EVAL-ADUC7121QSPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 37/96页 |
| 文件大小： | 0K |
| 描述： | BOARD EVALUATION FOR ADUC7121 |
| 设计资源： | ADUC7121 Gerber Files ADUC7121 Schematic |
| 标准包装： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 类型： | MCU |
| 适用于相关产品： | ADUC7121 |
| 所含物品： | 板，CD |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页当前第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页
ADuC7121
Data Sheet
Rev. B | Page 42 of 96
Table 51. DACxCON Registers (Default Value = 0x100, Read/Write Access)
Name
Address
DAC0CON
0xFFFF0580
DAC1CON
0xFFFF0588
DAC2CON
0xFFFF05B0
DAC3CON
0xFFFF05D8
Table 52. DAC0CON MMR Bit Designations
Bit
Value
Name
Description
15:9
0
Reserved.
8
1
DACPD
DAC power-down. Set by the user to set DACOUTx to tristate mode.
7
0
DACBUF_LP
DAC buffer low power mode. Set by the user to place DAC_BUFF into a low power mode.
6
0
BYP
DAC bypass bit.
Set this bit to bypass the DAC buffer.
Cleared to buffer the DAC output.
5
0
DACCLK
DAC update rate.
Set by the user to update the DAC using Timer1.
Cleared by the user to update the DAC using HCLK (core clock).
4
0
DACCLR
DAC clear bit.
Set by the user to enable normal DAC operation.
Cleared by the user to reset data register of the DAC to 0.
3
0
Mode
Mode bit.
Set by the user to operate on DAC normal mode and turn off the interpolator clock source. Cleared by the
user to enable the interpolation mode.
2
0
Rate
Rate bit. Set by the user to enable the interpolation clock to HCLK/16. Cleared by the user to HCLK/32.
1:0
DACRNx
DAC range bits.
00
DAC range is from AGND to the internal reference.
01
EXT_REF DAC range is from AGND to the external reference. See the REFCON MMR in Table 39 for details.
10
EXT_REF DAC range is from AGND to the external reference. See the REFCON MMR in Table 39 for more
details.
11
AVDD and AGND.
Table 53. DACxDAT Registers (Default Value = 0x00000000, Read/Write Access)
Name
Address
DAC0DAT
0xFFFF0584
DAC1DAT
0xFFFF058C
DAC2DAT
0xFFFF05B4
DAC3DAT
0xFFFF05DC
Table 54. DACxDAT MMR Bit Designations
Bit
Description
31:28
Reserved.
27:16
12-bit data for DACx.
15:12
Extra bits for interpolation mode.
11:0
Reserved.
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PDF描述 |
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