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参数资料
| 型号： | EVAL-ADUC7121QSPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 6/96页 |
| 文件大小： | 0K |
| 描述： | BOARD EVALUATION FOR ADUC7121 |
| 设计资源： | ADUC7121 Gerber Files ADUC7121 Schematic |
| 标准包装： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 类型： | MCU |
| 适用于相关产品： | ADUC7121 |
| 所含物品： | 板，CD |
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ADuC7121
Data Sheet
Rev. B | Page 14 of 96
Table 7. SPI Slave Mode Timing (Phase Mode = 0)
Parameter
Description
Min
Typ
Max
Unit
t
CS
200
ns
tSL
(SPIDIV + 1) × tUCLK
ns
tSH
SPICLK high pulse width2
(SPIDIV + 1) × tUCLK
ns
tDAV
Data output valid after SPICLK edge
25
ns
tDSU
Data input setup time before SPICLK edge2
1 × tUCLK
ns
tDHD
Data input hold time after SPICLK edge2
2 × tUCLK
ns
tDF
Data output fall time
5
12.5
ns
tDR
Data output rise time
5
12.5
ns
tSR
SPICLK rise time
5
12.5
ns
tSF
SPICLK fall time
5
12.5
ns
tDOCS
Data output valid after CS edge
25
ns
tSFS
CS high after SPICLK edge
0
ns
1
CS is the CS (SPI slave select input) function of the multifunction Pin F3.
2
tUCLK = 23.9 ns. It corresponds to the 41.78 MHz internal clock from the PLL before the clock divider.
Figure 6. SPI Slave Mode Timing (Phase Mode = 0)
SPICLK
(POLARITY = 0)
CS
SPICLK
(POLARITY = 1)
tSH
tSL
tSR
tSF
tSFS
MISO
MOSI
MSB IN
BIT 6 TO BIT 1
LSB IN
tDHD
tDSU
MSB
BIT 6 TO BIT 1
LSB
tDOCS
tDAV
tDR
tDF
tCS
09492-
006
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