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参数资料
| 型号： | EVAL-ADUC7121QSPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 43/96页 |
| 文件大小： | 0K |
| 描述： | BOARD EVALUATION FOR ADUC7121 |
| 设计资源： | ADUC7121 Gerber Files ADUC7121 Schematic |
| 标准包装： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 类型： | MCU |
| 适用于相关产品： | ADUC7121 |
| 所含物品： | 板，CD |
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ADuC7121
Data Sheet
Rev. B | Page 48 of 96
MMRs and Keys
To prevent accidental programming, a certain sequence must be
followed when writing in the PLLCON and POWCON registers
(see Table 69).
PLLKEYx Registers
Name:
PLLKEY1
Address:
0xFFFF0410
Default value:
0x0000
Access:
Write only
Name:
PLLKEY2
Address:
0xFFFF0418
Default value:
0x0000
Access:
Write only
PLLCON Register
Name:
PLLCON
Address:
0xFFFF0414
Default value:
0x21
Access:
Read and write
Table 67. PLLCON MMR Bit Designations
Bit
Value
Name
Description
7:6
Reserved.
5
OSEL
32 kHz PLL input selection.
Set by the user to use the internal
32 kHz oscillator.
Set by default.
Cleared by the user to use the external
32 kHz crystal.
4:2
Reserved.
1:0
MDCLK
Clocking modes.
00
Reserved.
01
PLL. Default configuration.
10
Reserved.
11
External clock on the
P1.4/PWM1/ECLK/XCLK/PLAI[8] pin.
POWKEYx Registers
Name:
POWKEY1
Address:
0xFFFF0404
Default value:
0x0000
Access:
Write only
Name:
POWKEY2
Address:
0xFFFF040C
Default value:
0x0000
Access:
Write only
POWCON Register
Name:
POWCON
Address:
0xFFFF0408
Default value:
0x0003
Access:
Read and write
Table 68. POWCON MMR Bit Designations
Bit
Value
Name
Description
7
Reserved.
6:4
PC
Operating modes.
000
Active mode.
001
Pause mode.
010
Nap mode.
011
Sleep mode. IRQ0 to IRQ3 and Timer2
can wake up the ADuC7121.
100
Stop mode.
Others
Reserved.
3
RSVD
Reserved.
2:0
CD
CPU clock divider bits.
000
41.779200 MHz.
001
20.889600 MHz.
010
10.444800 MHz.
011
5.222400 MHz.
100
2.611200 MHz.
101
1.305600 MHz.
110
654.800 kHz.
111
326.400 kHz.
Table 69. PLLCON and POWCON Write Sequence
PLLCON
POWCON
PLLKEY1 = 0xAA
POWKEY1 = 0x01
PLLCON = 0x01
POWCON = user value
PLLKEY2 = 0x55
POWKEY2 = 0xF4
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