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参数资料
| 型号： | EVAL-ADUC7121QSPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 58/96页 |
| 文件大小： | 0K |
| 描述： | BOARD EVALUATION FOR ADUC7121 |
| 设计资源： | ADUC7121 Gerber Files ADUC7121 Schematic |
| 标准包装： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 类型： | MCU |
| 适用于相关产品： | ADUC7121 |
| 所含物品： | 板，CD |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页当前第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页
Data Sheet
ADuC7121
Rev. B | Page 61 of 96
UART Interrupt Enable Register 0
This 8-bit register enables and disables the individual UART
interrupt sources.
Name:
COMIEN0
Address:
0xFFFF0804
Default value: 0x00
Access:
Read and write
Table 86. COMIEN0 MMR Bit Designations
Bit
Name
Description
7 to 3
Reserved. Not used.
Cleared by the user.
2
ELSI
Receive pin (SIN) status interrupt enable
bit.
Set by the user to enable generation of
an interrupt if any of the COMSTA0[3:1]
register bits are set.
Cleared by the user.
1
ETBEI
Enable transmit buffer empty interrupt.
Set by the user to enable an interrupt
when the buffer is empty during a
transmission, that is, when COMSTA[5]
is set.
Cleared by the user.
0
ERBFI
Enable receive buffer full interrupt.
Set by the user to enable an interrupt
when the buffer is full during a
reception.
Cleared by the user.
UART Interrupt Identification Register 0
This 8-bit register reflects the source of the UART interrupt.
Name:
COMIID0
Address:
0xFFFF0808
Default value: 0x01
Access:
Read only
Table 87. COMIID0 MMR Bit Designations
Bits[2:1]
Status
Bits
Bit 0
NINT
Priority
Definition
Clearing
Operation
00
1
No interrupt
11
0
1
Receive line
status
interrupt
Read
COMSTA0
10
0
2
Receive
buffer full
interrupt
Read COMRX
01
0
3
Transmit
buffer empty
interrupt
Write data to
COMTX or
read COMIID0
00
0
4
Modem
status
interrupt
Read
COMSTA1
register
UART Fractional Divider Register
This 16-bit register controls the operation of the fractional
divider for the ADuC7121.
Name:
COMDIV2
Address:
0xFFFF082C
Default value: 0x0000
Access:
Read and write
Table 88. COMDIV2 MMR Bit Designations
Bit
Name
Description
15
FBEN
Fractional baud rate generator enable bit.
Set by the user to enable the fractional
baud rate generator.
Cleared by the user to generate the baud
rate using the standard 450 UART baud rate
generator.
14:13
Reserved.
12:11
FBM[1:0]
M. If FBM = 0, M = 4. See Equation 2 for the
calculation of the baud rate using a
fractional divider and Table 82 for common
baud rate values.
10:0
FBN[10:0]
N. See Equation 2 for the calculation of the
baud rate using a fractional divider and
Table 82 for common baud rate values.
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PDF描述 |
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