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参数资料
型号： EVAL-ADUC7121QSPZ
厂商： Analog Devices Inc
文件页数： 49/96页
文件大小： 0K
描述： BOARD EVALUATION FOR ADUC7121
设计资源： ADUC7121 Gerber Files
ADUC7121 Schematic
标准包装： 1
系列： MicroConverter® ADuC7xxx
类型： MCU
适用于相关产品： ADUC7121
所含物品： 板，CD
Data Sheet
ADuC7121
Rev. B | Page 53 of 96
Table 75. GPIO Pin Function Designations
Configuration (See GPxCON Table 76)
Port
Pin
00
01
10
11
0
P0.0
GPIO
SCL0
PLAI[5]
P0.1
GPIO
SDA0
JTAG disabled
PLAI[4]
P0.2
GPIO
SPICLK
JTAG disabled ADCBUSY
PLAO[13]
P0.3
GPIO
MISO
SYNC (PWM)
PLAO[12]
P0.4
GPIO
MOSI
TRIP (PWM)
PLAI[11]
P0.5
GPIO
CS
ADCCONVST
PLAI[10]
P0.6
GPIO
MRST
PLAI[2]
P0.7
GPIO
TRST
PLAI[3]
1
P1.0
GPIO
SIN
SCL1
PLAI[7]
P1.1
GPIO
SOUT
SDA1
PLAI[6]
P1.21
TDI (JTAG)
PLAO[15]
P1.31
TDO (JTAG)
PLAO[14]
P1.4
GPIO
PWM1
ECLK/XCLK
PLAI[8]
P1.5
GPIO
PWM2
PLAI[9]
P1.6
GPIO
PLAO[5]
P1.7
GPIO
PLAO[4]
2
P2.0
GPIO/IRQ0
PLAI[13]
P2.1
GPIO/IRQ1
PLAI[12]
P2.2
GPIO
PLAI[1]
P2.3
GPIO/IRQ2
PLAI[14]
P2.4
GPIO
PWM5
PLAO[7]
P2.5
GPIO
PWM6
PLAO[6]
P2.6
GPIO/IRQ3
PLAI[15]
P2.7
GPIO
PLAI[0]
3
P3.0
GPIO
PLAO[0]
P3.1
GPIO
PLAO[1]
P3.2
GPIO/IRQ4
PWM3
PLAO[2]
P3.3
GPIO/IRQ5
PWM4
PLAO[3]
P3.4
GPIO
PLAO[8]
P3.5
GPIO
PLAO[9]
P3.6
GPIO
PLAO[10]
P3.7
GPIO/BM
PLAO[11]
1
Reconfiguring these pins disables JTAG mode. Erase part to reenable JTAG access after changing default value.
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PDF描述
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