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参数资料
| 型号： | EVAL-ADUC7124QSPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 68/108页 |
| 文件大小： | 0K |
| 描述： | BOARD EVALUATION FOR ADUC7124 |
| 设计资源： | EVAL-ADUC7124 Schematic ADUC7124 Eval Brd Gerber Files |
| 标准包装： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 类型： | MCU |
| 适用于相关产品： | ADUC7124 |
| 所含物品： | 板 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页当前第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页
ADuC7124/ADuC7126
Data Sheet
Rev. C | Page 62 of 108
COM1DIV0 Register
Name:
COM1DIV0
Address:
0xFFFF0740
Default Value:
0x00
Access:
Read/write
COM1DIV0 is a low byte divisor latch for UART1. COM1TX,
COM1RX, and COM1DIV0 share the same address location.
COM1TX and COM1RX can be accessed when Bit 7 in
COM1CON0 register is cleared. COM1DIV0 can be accessed
when Bit 7 of COM1CON0 is set.
COM0IEN0 Register
Name:
COM0IEN0
Address:
0xFFFF0704
Default Value:
0x00
Access:
Read/write
COM0IEN0 is the interrupt enable register for UART0.
COM1IEN0 Register
Name:
COM1IEN0
Address:
0xFFFF0744
Default Value:
0x00
Access:
Read/write
COM1IEN0 is the interrupt enable register for UART1.
Table 92. COMxIEN0 MMR Bit Descriptions
Bit
Name
Description
[7:4]
Reserved.
3
EDSSI
Modem status interrupt enable bit.
Set by the user to enable generation of an
interrupt if any of COMXSTA1[3:1] are set.
Cleared by the user.
2
ELSI
Rx status interrupt enable bit.
Set by the user to enable generation of an
interrupt if any of COMxSTA0[3:0] are set.
Cleared by the user.
1
ETBEI
Enable transmit buffer empty interrupt.
Set by the user to enable interrupt when the
buffer is empty during a transmission.
Cleared by the user.
0
ERBFI
Enable receive buffer full interrupt.
In non-FIFO mode, set by the user to enable
an interrupt when buffer is full during a
reception. Cleared by the user.
In FIFO mode, set by the user to enable an
interrupt when trigger level is reached. It also
controls the character receive timeout
interrupt. Cleared by the user.
COM0DIV1 Register
Name:
COM0DIV1
Address:
0xFFFF0704
Default Value:
0x00
Access:
Read/write
COM0DIV1 is a divisor latch (high byte) register for UART0.
COM1DIV1 Register
Name:
COM1DIV1
Address:
0xFFFF0744
Default Value:
0x00
Access:
Read/write
COM1DIV1 is a divisor latch (high byte) register for UART1.
COM0IID0 Register
Name:
COM0IID0
Address:
0xFFFF0708
Default Value:
0x01
Access:
Read only
COM0IID0 is the interrupt identification register for UART0. It
also indicates if the UART is in FIFO mode.
COM1IID0 Register
Name:
COM1IID0
Address:
0xFFFF0748
Default Value:
0x01
Access:
Read only
COM1IID0 is the interrupt identification register for UART1. It
also indicates if the UART is in FIFO mode.
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