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参数资料
型号： EVAL-ADUC7124QSPZ
厂商： Analog Devices Inc
文件页数： 15/108页
文件大小： 0K
描述： BOARD EVALUATION FOR ADUC7124
设计资源： EVAL-ADUC7124 Schematic
ADUC7124 Eval Brd Gerber Files
标准包装： 1
系列： MicroConverter® ADuC7xxx
类型： MCU
适用于相关产品： ADUC7124
所含物品： 板
ADuC7124/ADuC7126
Data Sheet
Rev. C | Page 14 of 108
PIN CONFIGURATIONS AND FUNCTION DESCRIPTIONS
PIN 1
INDICATOR
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
DG
ND
LV
DD
IO
V
DD
IO
GN
D
P
4.6
/P
LA
O
[1
4]
P
4.7
/P
LA
O
[1
5]
P
0.6
/T
1/M
R
S
T
/P
L
A
O[
3]
TC
K
TD
O
P3
.0
/PW
M
0/
PL
A
I[
8]
P3
.1
/PW
M
1/
PL
A
I[
9]
P
3.
2/
P
W
M
2/
P
L
AI
[10]
P
3.3
/P
WM
3/
P
L
A
I[
11
]
P
0.
3/
T
RS
T
/ADC
BU
S
Y
P
3.
4/
P
W
M
4/
P
L
AI
[12]
P
3.
5/
P
W
M
5/
P
L
AI
[13]
64
63
62
61
60
59
58
57
56
55
54
53
52
51
50
49
ADC3/
C
M
P
1
ADC2/
C
M
P
0
ADC1
ADC0
GN
D
REF
AG
ND
AV
DD
DAC
RE
F
V
REF
RT
CK
P
4.4
/P
L
A
O[
12
]
P
4.3
/P
L
A
O[
11
]
P
4.2
/P
L
A
O[
10
]
P
1.0
/T
1/
S
P
M
0/S
IN
0/I2
C
0S
C
L/
P
L
A
I[
0]
P
1.
1/
S
P
M
1/
S
O
UT
0/
I2
C0
S
DA/
P
L
AI
[1
]
P
1.2
/S
P
M
2/
R
T
S
/I2
C
1S
C
L/
P
L
A
I[
2]
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
ADC4
ADC5
ADC6
ADC7
ADC8
ADC9
ADCNEG
DACGND
DACVDD
DAC0/ADC12
DAC1/ADC13
TMS
TDI
XCLKO
XCLKI
BM/P0.0/CMPOUT/PLAI[7]
NC = NO CONNECT
P1.3/SPM3/CTS/I2C1SDA/PLAI[3]
P1.4/SPM4/RI/SPICLK/PLAI[4]/IRQ2
P1.5/SPM5/DCD/SPIMISO/PLAI[5]/IRQ3
P4.1/PLAO[9]/SOUT1
P4.0/PLAO[8]/SIN1
P1.6/SPM6/PLAI[6]
P1.7/SPM7/DTR/SPICS/PLAO[0]
P3.7/PWMSYNC/PLAI[15]
P3.6/PWMTRIP/PLAI[14]
IOVDD
IOGND
P0.7/ECLK/XCLK/SPM8/PLAO[4]/SIN0
P2.0/SPM9/PLAO[5]/CONVSTART/SOUT0
IRQ1/P0.5/ADCBUSY/PLAO[2]
IRQ0/P0.4/PWMTRIP/PLAO[1]
RST
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
ADuC7124
TOP VIEW
(Not to Scale)
091
23
-10
7
NOTES
1. THE EXPOSED PADDLE MUST BE SOLDERED TO THE PCB TO ENSURE PROPER
HEAT DISSIPATION, NOISE, AND MECHANICAL STRENGTH BENEFITS.
Figure 7. ADuC7124 Pin Configuration
Table 9. Pin Function Descriptions (ADuC7124 64-Lead LFCSP)
Pin No.
Mnemonic
Description
0
Exposed Paddle
Exposed Paddle. The LFCSP_VQ has an exposed paddle that must be left unconnected.
1
ADC4
Single-Ended or Differential Analog Input 4.
2
ADC5
Single-Ended or Differential Analog Input 5.
3
ADC6
Single-Ended or Differential Analog Input 6.
4
ADC7
Single-Ended or Differential Analog Input 7.
5
ADC8
Single-Ended or Differential Analog Input 8.
6
ADC9
Single-Ended or Differential Analog Input 9.
7
ADCNEG
Bias Point or Negative Analog Input of the ADC in Pseudo Differential Mode. Must be
connected to the ground of the signal to convert. This bias point must be between 0 V
and 1 V.
8
DACGND
Ground for the DAC. Typically connected to AGND.
9
DACVDD
3.3 V Power Supply for the DACs. Must be connected to AVDD.
10
DAC0/ADC12
DAC0 Voltage Output (DAC0).
Single-Ended or Differential Analog Input 12 (ADC12).
11
DAC1/ADC13
DAC1 Voltage Output (DAC1).
Single-Ended or Differential Analog Input 13 (ADC13).
12
TMS
JTAG Test Port Input, Test Mode Select. Debug and download access.
13
TDI
JTAG Test Port Input, Test Data In.
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