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参数资料
| 型号： | EVAL-ADUC7124QSPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 50/108页 |
| 文件大小： | 0K |
| 描述： | BOARD EVALUATION FOR ADUC7124 |
| 设计资源： | EVAL-ADUC7124 Schematic ADUC7124 Eval Brd Gerber Files |
| 标准包装： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 类型： | MCU |
| 适用于相关产品： | ADUC7124 |
| 所含物品： | 板 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页当前第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页
ADuC7124/ADuC7126
Data Sheet
Rev. C | Page 46 of 108
Table 45. FEE1STA Register
Name
Address
Default Value
Access
FEE1STA
0xFFFFF880
0x0000
R
Table 46. FEE1MOD Register
Name
Address
Default Value
Access
FEE1MOD
0xFFFFF884
0x80
R/W
Table 47. FEE1CON Register
Name
Address
Default Value
Access
FEE1CON
0xFFFFF888
0x00
R/W
Table 48. FEE1DAT Register
Name
Address
Default Value
Access
FEE1DAT
0xFFFFF88C
0xXXXX
R/W
FEE1DAT is a 16-bit data register.
Table 49. FEE1ADR Register
Name
Address
Default Value
Access
FEE1ADR
0xFFFFF890
0x0000
R/W
FEE1ADR is a 16-bit address register.
Table 50. FEE1SGN Register
Name
Address
Default Value
Access
FEE1SGN
0xFFFFF898
0xFFFFFF
R
FEE1SGN is a 24-bit code signature.
Table 51. FEE1PRO Register
Name
Address
Default Value
Access
FEE1PRO
0xFFFFF89C
0x00000000
R/W
FEE1PRO provides protection following subsequent reset MMR.
It requires a software key (see Table 57).
Table 52. FEE1HID Register
Name
Address
Default Value
Access
FEE1HID
0xFFFFF8A0
0xFFFFFFFF
R/W
FEE1HID provides immediate protection MMR. It does not
require any software keys (see Table 57).
Command Sequence for Executing a Mass Erase
FEE0DAT = 0x3CFF;
FEE0ADR = 0xFFC3;
FEE0MOD = FEE0MOD|0x8; //Erase key enable
FEE0CON = 0x06;
//Mass erase
command
Table 53. FEExSTA MMR Bit Descriptions
Bit
Description
[15:6]
Reserved.
5
Reserved.
4
Reserved.
3
Flash/EE interrupt status bit.
Set automatically when an interrupt occurs, that is, when a command is complete and the Flash/EE interrupt enable bit in the
FEExMOD register is set.
Cleared when reading the FEExSTA register.
2
Flash/EE controller busy.
Set automatically when the controller is busy.
Cleared automatically when the controller is not busy.
1
Command fail.
Set automatically when a command completes unsuccessfully.
Cleared automatically when reading the FEExSTA register.
0
Command complete.
Set by MicroConverter when a command is complete.
Cleared automatically when reading the FEExSTA register.
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