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参数资料
| 型号： | EVAL-ADUC7124QSPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 19/108页 |
| 文件大小： | 0K |
| 描述： | BOARD EVALUATION FOR ADUC7124 |
| 设计资源： | EVAL-ADUC7124 Schematic ADUC7124 Eval Brd Gerber Files |
| 标准包装： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 类型： | MCU |
| 适用于相关产品： | ADUC7124 |
| 所含物品： | 板 |
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ADuC7124/ADuC7126
Data Sheet
Rev. C | Page 18 of 108
2
ADC5
3
ADC6
4
ADC7
7
ADC10
6
ADC9
5
ADC8
1
ADC4
8
ADCNEG
9
DACGND
10
DACVDD
12
DAC1/ADC13
13
DAC2/ADC14
14
DAC3/ADC15
15
TMS
16
TDI
17
P0.1/PWM4/BLE
18
XCLKO
19
XCLKI
20
BM/P0.0/CMPOUT/PLAI[7]/MS0
11
DAC0/ADC12
59
58
57
54
55
56
60
53
52
P1.4/SPM4/RI/SPICLK/PLAI[4]/IRQ2
P1.5/SPM5/DCD/SPIMISO/PLAI[5]/IRQ3
P4.1/SPM11/SOUT1/AD9/PLAO[9]
P1.7/SPM7/DTR/SPICS/PLAO[0]
P1.6/SPM6/PLAI[6]
P4.0/SPM10/SIN1/AD8/PLAO[8]
P1.3/SPM3/CTS/I2C1SDA/PLAI[3]
P3.7/AD7/PWMSYNC/PLAI[15]
P3.6/AD6/PWMTRIP/PLAI[14]
51
P2.2/RS/PWM1/PLAO[7]
49
P2.3/SPM12/AE/SIN1
48
IOVDD
47
IOGND
46
P0.7/SPM8/ECLK/XCLK/PLAO[4]/SIN0
45
P2.0/SPM9/PLAO[5]/CONVSTART/SOUT0
44
P2.7/PWM3/MS3
43
IRQ1/P0.5/ADCBUSY/PLAO[2]/MS2
42
IRQ0/P0.4/PWMTRIP/PLAO[1]/MS1
41
RST
50
P2.1/WS/PWM0/PLAO[6]
21
DG
ND
22
LV
DD
23
IO
V
DD
24
IOG
N
D
25
P4
.6
/A
D
14
/PL
A
O
[1
4]
26
P4
.7
/A
D
15
/PL
A
O
[1
5]
27
P
0.6
/T
1/
M
R
S
T
/P
L
A
O[
3]
/M
S
3
28
TC
K
29
TD
O
30
P
0.2
/P
WM
5/
B
H
E
31
P3
.0
/A
D
0/
PW
M
0/
PL
A
I[
8]
32
P3
.1
/A
D
1/
PW
M
1/
PL
A
I[
9]
33
P
3.2
/A
D
2/P
W
M
2/P
L
A
I[
10
]
34
P
3.
3/
AD3/
P
W
M
3/
P
L
AI
[1
1]
35
P
2.4
/S
P
M
13
/P
W
M
0/M
S
0/S
OU
T
1
36
P
0.3
/T
R
S
T
/A
16
/A
D
C
BU
S
Y
37
P
2.5
/P
WM
1/
M
S
1
38
P
2.6
/P
WM
2/
M
S
2
39
P
3.4
/A
D
4/P
W
M
4/P
L
A
I[
12
]
40
P
3.5
/A
D
5/P
W
M
5/P
L
A
I[
13
]
80
ADC3/
C
M
P
1
79
ADC2/
C
M
P
0
78
ADC1
77
ADC0
76
ADC
11
75
GN
D
REF
74
AG
ND
73
AG
ND
72
AV
DD
71
DAC
RE
F
70
V
RE
F
69
IOG
N
D
68
IOV
DD
67
P
4.
5/
AD1
3/
P
L
AO
[1
3]
/R
T
C
K
66
P
4.
4/
AD1
2/
P
L
AO
[1
2]
65
P
4.3
/A
D1
1/
P
L
A
O
[1
1]
64
P
4.
2/
AD1
0/
P
L
AO
[1
0]
63
P
1.0
/T
1/
S
P
M
0/S
IN
0/
I2
C
0S
C
L/
P
L
A
I[
0]
62
P1
.1
/SPM
1/
SO
U
T
0/
I2
C
0S
D
A
/PL
A
I[
1]
61
P1
.2
/SPM
2/
R
T
S/
I2
C
1SC
L
/P
L
A
I[2
]
PIN 1
TOP VIEW
091
23
-10
8
ADuC7126
Figure 8. ADuC7126 Pin Configuration
Table 10. Pin Function Descriptions (ADuC7126 80-Lead LQFP)
Pin No.
Mnemonic
Description
1
ADC4
Single-Ended or Differential Analog Input 4.
2
ADC5
Single-Ended or Differential Analog Input 5.
3
ADC6
Single-Ended or Differential Analog Input 6.
4
ADC7
Single-Ended or Differential Analog Input 7.
5
ADC8
Single-Ended or Differential Analog Input 8.
6
ADC9
Single-Ended or Differential Analog Input 9.
7
ADC10
Single-Ended or Differential Analog Input 10.
8
ADCNEG
Bias Point or Negative Analog Input of the ADC in Pseudo Differential Mode. Must be
connected to the ground of the signal to convert. This bias point must be between 0 V
and 1 V.
9
DACGND
Ground for the DAC. Typically connected to AGND.
10
DACVDD
3.3 V Power Supply for the DACs. Must be connected to AVDD.
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PDF描述 |
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