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参数资料
| 型号： | EVAL-ADUC7124QSPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 62/108页 |
| 文件大小： | 0K |
| 描述： | BOARD EVALUATION FOR ADUC7124 |
| 设计资源： | EVAL-ADUC7124 Schematic ADUC7124 Eval Brd Gerber Files |
| 标准包装： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 类型： | MCU |
| 适用于相关产品： | ADUC7124 |
| 所含物品： | 板 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页当前第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页
Data Sheet
ADuC7124/ADuC7126
Rev. C | Page 57 of 108
Table 77. POWCON1 MMR Bit Descriptions1
Bit
Value
Name
Description
[15:12]
Reserved.
11
1
PWMPO
Clearing this bit powers
down the PWM. Always
clear to 00.
[10:9]
00
PWMCLKDIV
8
SPIPO
Clearing this bit powers
down the SPI.
[7:6]
SPICLKDIV
SPI block driving clock
divider bits.
00
41.78 MHz.
01
20.89 MHz.
10
10.44 MHz.
11
5.22 MHz.
5
I2C1PO
Clearing this bit powers
down I2C1.
[4:3]
I2C1CLKDIV
I2C0 block driving clock
divider bits.
00
41.78 MHz.
01
10.44 MHz.
10
5.22 MHz.
11
1.31 MHz.
2
I2C0PO
Clearing this bit powers
down I2C0.
[1:0]
I2C0CLKDIV
I2C1 block driving clock
divider bits.
00
41.78 MHz.
01
10.44 MHz.
10
5.22 MHz.
11
1.31 MHz.
The POWCON1 write sequence is as follows:
1.
Write Code 0x76 to Register POWKEY3.
2.
Write user value to Register POWCON1.
3.
Write Code 0xB1 to Register POWKEY4.
1 Divided clock for SPI/I2C0/I2C1 must be greater than or equal to the CPU clock
as selected by POWCON0 [2:0].
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