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参数资料
| 型号： | EVAL-ADUC7122QSPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 90/96页 |
| 文件大小： | 0K |
| 描述： | BOARD EVALUATION FOR ADUC7122 |
| 设计资源： | EVAL-ADUC7122 Schematic ADUC7122 Gerber Files ADUC7122 BOM |
| 标准包装： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 类型： | MCU |
| 适用于相关产品： | ADUC7122 |
| 所含物品： | 板 |
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ADuC7122
Rev. 0 | Page 90 of 96
Table 168. T3CON MMR Bit Designations
Bit
Value
Description
16:9
These bits are reserved and should be written as 0s by user code.
8
Count up/down enable.
1
Set by user code to configure Timer3 to count up.
0
Cleared by user code to configure Timer3 to count down.
7
Timer3 enable.
1
Set by user code to enable Timer3.
0
Cleared by user code to disable Timer3.
6
Timer3 operating mode.
1
Set by user code to configure Timer3 to operate in periodic mode.
0
Cleared by user to configure Timer3 to operate in free-running mode.
5
Watchdog timer mode enable.
1
Set by user code to enable watchdog mode.
0
Cleared by user code to disable watchdog mode.
4
Secure clear bit.
1
Set by the user to use the secure clear option.
0
Cleared by the user to disable the secure clear option by default.
3:2
Timer3 clock (32.768 kHz) prescaler.
00
Source clock/1 (default).
01
Reserved.
10
Reserved.
11
Reserved.
1
Watchdog timer IRQ enable.
1
Set by the user code to produce an IRQ instead of a reset when the watchdog reaches 0.
0
Cleared by the user code to disable the IRQ option.
0
PD_OFF.
1
Set by user code to stop Timer3 when the peripherals are powered down via Bits[6:4] in the POWCON MMR.
0
Cleared by user code to enable Timer3 when the peripherals are powered down via Bits[6:4] in the POWCON MMR.
相关PDF资料 |
PDF描述 |
|---|---|
| EVAL-ADUC7124QSPZ | BOARD EVALUATION FOR ADUC7124 |
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| EVAL-ADUC7126QSPZ | BOARD EVALUATION FOR ADUC7126 |
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相关代理商/技术参数 |
参数描述 |
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