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参数资料
| 型号： | EVAL-ADUC7122QSPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 48/96页 |
| 文件大小： | 0K |
| 描述： | BOARD EVALUATION FOR ADUC7122 |
| 设计资源： | EVAL-ADUC7122 Schematic ADUC7122 Gerber Files ADUC7122 BOM |
| 标准包装： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 类型： | MCU |
| 适用于相关产品： | ADUC7122 |
| 所含物品： | 板 |
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ADuC7122
Rev. 0 | Page 52 of 96
GENERAL-PURPOSE I/O
The ADuC7122 provides 32 general-purpose, bidirectional I/O
(GPIO) pins. All I/O pins are 5 V tolerant, meaning that the
GPIOs support an input voltage of 5 V. In general, many of the
GPIO pins have multiple functions (see Table 84). By default, the
GPIO pins are configured in GPIO mode.
All GPIO pins have an internal pull-up resistor (of about 100 kΩ),
and their drive capability is 1.6 mA. Note that a maximum of
20 GPIOs can drive 1.6 mA at the same time. The 32 GPIOs are
grouped in four ports: Port 0 to Port 3. Each port is controlled
by four or five MMRs, with x representing the port number.
Table 82. GPxCON Register
Name
Address
Default Value
Access
GP0CON
0xFFFF0D00
0x00000000
R/W
GP1CON
0xFFFF0D04
0x00000000
R/W
GP2CON
0xFFFF0D08
0x00000000
R/W
GP3CON
0xFFFF0D0C
0x11111111
R/W
The input level of any GPIO can be read at any time in the
GPxDAT MMR, even when the pin is configured in a mode
other than GPIO. The PLA input is always active.
When the ADuC7122 parts enter a power-saving mode, the
GPIO pins retain their state.
GPxCON is the Port x control register, and it selects the
function of each pin of Port x, as described in Table 84.
Table 83. GPxCON MMR Bit Designations
Bit
Description
31:30
Reserved
29:28
Select function of Px.7 pin
27:26
Reserved
25:24
Select function of Px.6 pin
23:22
Reserved
21:20
Select function of Px.5 pin
19:18
Reserved
17:16
Select function of Px.4 pin
15:14
Reserved
13:12
Select function of Px.3 pin
11:10
Reserved
9:8
Select function of Px.2 pin
7:6
Reserved
5:4
Select function of Px.1 pin
3:2
Reserved
1:0
Select function of Px.0 pin
Table 84. GPIO Pin Function Designations1
Configuration (see GPxCON)
Port
Pin
00
01
10
11
0
P0.0
GPIO
SCL1
N/A
PLAI[5]
P0.1
GPIO
SDA1
N/A
PLAI[4]
P0.2
GPIO
SPICLK
ADCBUSY
PLAO[13]
P0.3
GPIO
SPIMISO
SYNC
PLAO[12]
P0.4
GPIO
SPIMOSI
TRIP
PLAI[11]
P0.5
GPIO
SPICS
CONVST
PLAI[10]
P0.6
GPIO
MRST
N/A
PLAI[2]
P0.7
GPIO
TRST
N/A
PLAI[3]
P1.0
GPIO
SIN
SCL2
PLAI[7]
P1.1
GPIO
SOUT
SDA2
PLAI[6]
P1.4
GPIO
PWM1
ECLK/XCLK
PLAI[8]
P1.5
GPIO
PWM2
N/A
PLAI[9]
P1.6
GPIO
N/A
PLAO[5]
P1.7
GPIO
N/A
PLAO[4]
2
P2.0
GPIO/IRQ0
N/A
PLAI[13]
P2.1
GPIO/IRQ1
N/A
PLAI[12]
P2.2
GPIO
N/A
PLAI[1]
P2.3
GPIO/IRQ2
N/A
PLAI[14]
P2.4
GPIO
PWM5
N/A
PLAO[7]
P2.5
GPIO
PWM6
N/A
PLAO[6]
P2.6
GPIO/IRQ3
N/A
PLAI[15]
P2.7
GPIO
N/A
PLAI[0]
3
P3.0
GPIO
N/A
PLAO[0]
P3.1
GPIO
N/A
PLAO[1]
P3.2
GPIO/IRQ4
PWM3
N/A
PLAO[2]
P3.3
GPIO/IRQ5
PWM4
N/A
PLAO[3]
P3.4
GPIO
N/A
PLAO[8]
P3.5
GPIO
N/A
PLAO[9]
P3.6
GPIO
N/A
PLAO[10]
P3.7/BM
GPIO
N/A
PLAO[11]
1 N/A means no secondary function exists.
2 Never attempt a write to P1.2 or P1.3.
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PDF描述 |
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