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参数资料
型号： EVAL-ADUC7122QSPZ
厂商： Analog Devices Inc
文件页数： 43/96页
文件大小： 0K
描述： BOARD EVALUATION FOR ADUC7122
设计资源： EVAL-ADUC7122 Schematic
ADUC7122 Gerber Files
ADUC7122 BOM
标准包装： 1
系列： MicroConverter® ADuC7xxx
类型： MCU
适用于相关产品： ADUC7122
所含物品： 板
ADuC7122
Rev. 0 | Page 48 of 96
MMRS AND KEYS
To prevent accidental programming, a certain sequence must be
followed when writing in the PLLCON and POWCON registers
(see Table 74).
Table 70. PLLKEYx Register
Name
Address
Default Value
Access
PLLKEY1
0xFFFF0410
0x0000
W
PLLKEY2
0xFFFF0418
0x0000
W
Table 71. PLLCON Register
Name
Address
Default Value
Access
PLLCON
0xFFFF0414
0x21
R/W
Table 72. POWKEYx Register
Name
Address
Default Value
Access
POWKEY1
0xFFFF0404
0x0000
W
POWKEY2
0xFFFF040C
0x0000
W
Table 73. POWCON Register
Name
Address
Default Value
Access
POWCON
0xFFFF0408
0x03
R/W
Table 74. PLLCON and POWCON Write Sequence
PLLCON
POWCON
PLLKEY1 = 0xAA
POWKEY1 = 0x01
PLLCON = 0x01
POWCON = user value
PLLKEY2 = 0x55
POWKEY2 = 0xF4
Table 75. PLLCON MMR Bit Designations
Bit
Value
Name
Description
7:6
Reserved.
5
OSEL
32 kHz PLL input selection.
1
Set by the user to use the internal
32 kHz oscillator. Set by default.
0
Cleared by the user to use the
external 32 kHz crystal.
4:2
Reserved.
1:0
MDCLK
Clocking modes.
00
Reserved.
01
PLL. default configuration.
10
Reserved.
11
External clock on P1.4 pin.
Table 76. POWCON MMR Bit Designations
Bit
Value
Name
Description
7
Reserved.
6:4
PC
Operating modes.
000
Active mode.
001
Pause mode.
010
Nap.
011
Sleep mode. IRQ0 to IRQ3 and Timer2
can wake up the ADuC7122.
100
Stop mode.
Others
Reserved.
3
RSVD
Reserved.
2:0
CD
CPU clock divider bits.
000
41.779200 MHz.
001
20.889600 MHz.
010
10.444800 MHz.
011
5.222400 MHz.
100
2.611200 MHz.
101
1.305600 MHz.
110
654.800 kHz.
111
326.400 kHz.
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PDF描述
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