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参数资料
| 型号： | 440EP |
| 厂商： | Applied Micro Circuits Corp. |
| 英文描述： | Power PC 440EP Embedded Processor |
| 中文描述： | 440EP的Power PC嵌入式处理器 |
| 文件页数： | 68/84页 |
| 文件大小： | 541K |
| 代理商： | 440EP |
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70
AMCC Proprietary
440EP – PPC440EP Embedded Processor
Revision 1.26 – April 25, 2007
Data Sheet
Table 17. I/O Specifications—333MHz to 533MHz
Notes:
1. PerClk rising edge at package pin with a 10pF load trails the internal PLB clock by approximately 1.3ns.
Signal
Input (ns)
Output (ns)
Output Current (mA)
Clock
Notes
Setup Time
(TIS min)
Hold Time
(TIH min)
Valid Delay
(TOV max)
Hold Time
(TOH min)
I/O H
(minimum)
I/O L
(minimum)
External Slave Peripheral Interface
DMAAck0:1
n/a
10
1
5.1
6.8
PerClk
DMAAck2:3
n/a
10
1
15.3
10.2
PerClk
DMAReq0:3
11.7
0.5
n/a
na
PerClk
EOT0:1/TC0:1
11.7
0.5
10
1
5.1
6.8
PerClk
EOT2:3/TC2:3
11.7
0.5
10
1
15.3
10.2
PerClk
PerAddr02:31
4
1
7.2
1.5
15.3
10.2
PerClk
PerBLast
4
1
6.5
1.5
15.3
10.2
PerClk
PerCS0:5
n/a
6.5
1.5
10.3
7.1
PerClk
PerData00:15
4
1
7.2
1.5
15.3
10.2
PerClk
PerOE
n/a
6.5
1.5
15.3
10.2
PerClk
PerReady
6
1
n/a
15.3
10.2
PerClk
PerR/W
4
1
6.5
1.5
15.3
10.2
PerClk
PerWBE0:1
4
1
6.5
1.5
15.3
10.2
PerClk
External Master Peripheral Interface
BusReq
n/a
6.5
1.5
7.1
9.6
PerClk
ExtAck
n/a
6.5
1.5
7.1
9.6
PerClk
ExtReq
4
1
n/a
PerClk
ExtReset
n/a
6.0
1.5
15.3
10.2
PerClk
HoldAck
n/a
6.5
1.5
7.1
9.6
PerClk
HoldReq
4
1
n/a
na
PerClk
HoldPri
4
1
n/a
na
PerClk
n/a
15.3
10.2
PLB Clk
1
PerErr
6
1
n/a
10.3
7.1
PerClk
NAND Flash Interface
NFALE
n/a
6.5
1.5
5.1
6.8
NFCE0:3
n/a
6.5
1.5
10.3
7.1
NFCLE
n/a
6.5
1.5
5.1
6.8
NFRdyBusy
4
1
n/a
na
NFREn
n/a
6.5
1.5
5.1
6.8
NFWEn
n/a
6.5
1.5
5.1
6.8
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PDF描述 |
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