参数资料
| 型号： | 71M6541F-DB |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 63/166页 |
| 文件大小： | 0K |
| 描述： | DEMO BOARD 71M6541F |
| 标准包装： | 1 |
| 系列： | * |
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71M6541D/F/G and 71M6542F/G Data Sheet
2.5.8.3 Digital I/O for the 71M6542F/G
A total of 55 combined SEG/DIO pins are available for the 71M6542D/F. These pins can be categorized
as follows:
36 combined DIO/LCD segment pins:
o
o
o
o
o
SEGDIO4…SEGDIO5 (2 pins)
SEGDIO9…SEGDIO25 (17 pins)
SEGDIO28…SEGDIO35 (8 pins)
SEGDIO40…SEGDIO45 (6 pins)
SEGDIO52…SEGDIO54 (3 pins)
15 combined DIO/LCD segment pins shared with other functions:
o
o
o
o
o
o
o
SEGDIO0/WPULSE, SEGDIO1/VPULSE (2 pins)
SEGDIO2/SDCK, SEGDIO3/SDATA (2 pins)
SEGDIO6/XPULSE, SEGDIO7/YPULSE (2 pins)
SEGDIO8/DI (1 pin)
SEGDIO26/COM5, SEGDIO27/COM4 (2 pins)
SEGDIO36/SPI_CSZ…SEGDIO39/SPI_CKI (4 pins)
SEGDIO51/OPT_TX, SEGDIO55/OPT_RX (2 pins)
5 dedicated SEG segment pins are available:
o
o
ICE Inteface pins: SEG48/E_RXTX, SEG49/E_TCLK, SEG50/E_RST (3 pins)
Test Port pins: SEG46/TMUX2OUT, SEG47/TMUXOUT (2 pins)
There are four dedicated common segment outputs (COM0…COM3) plus the two additional shared common
segment outputs that are listed under combined SEG/DIO shared pins (SEGDIO26/COM5,
SEGDIO27/COM4).
Thus, in a configuration where none of these pins are used as DIOs, there can be up to 55 LCD segment
pins with 4 commons, or 54 LCD segment pins with 6 commons. And in a configuration where LCD
segment pins are not used, there can be up to 50 DIO pins.
Example: SEGDIO12 (see pin 32 in Table 52 ) is configured as a DIO output pin with a value of 1 (high) by
writing 0 to bit 4 of LCD_MAP[15:8] , and writing 1 to both P3[4]and P3[0] . The same pin is configured as
an LCD driver by writing 1 to bit 4 of LCD_MAP[15:8] . The display information is written to bits 0 to 5 of
LCD_SEG12.
The configuration for pins SEGDIO16 to SEGDIO31 is shown in Table 53 , the configuration for pins
SEGDIO32 to SEGDIO45 is shown in Table 54. SEG46 through SEG50 cannot be configured as DIO
Table 52: Data/Direction Registers for SEGDIO0 to SEGDIO15 (71M6542F/G)
SEGDIO
Pin #
Configuration:
0
45
0
1
44
1
2
43
2
3
42
3
4
41
4
5
39
5
6
38
6
7
37
7
8
36
0
9
35
1
10
34
2
11
33
3
12
32
4
13
31
5
14
30
6
15
29
7
0 = DIO, 1 = LCD
LCD_MAP[7:0] (I/O RAM 0x240B)
LCD_MAP[15:8] (I/O RAM 0x240A)
SEG Data Register
0
1 2 3 4 5 6 7 8 9 10 11 12 13 14
LCD_SEG0[5:0] to LCD_SEG15[5:0] (I/O RAM 0x2410[5:0] to 0x241F[5:0]
15
DIO Data Register
0
1 2
P0 ( SFR 0x80 )
3
0
1 2
P1 (SFR 0x90)
3
0
1 2
P2 ( SFR 0xA0 )
3
0
1 2
P3 ( SFR 0xB0 )
3
Direction Register:
4
5
6
7
4
5
6
7
4
5
6
7
4
5
6
7
0 = input, 1 = output
P0 ( SFR 0x80 )
P1 ( SFR 0x0 )
P2 ( SFR 0xA0 )
P3 ( SFR 0xB0 )
Internal Resources
Configurable
–
–
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
–
–
–
–
Rev 4
63
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PDF描述 |
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