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参数资料
| 型号： | TMDXCNCD28069ISO |
| 厂商： | Texas Instruments |
| 文件页数： | 137/174页 |
| 文件大小： | 0K |
| 描述： | EVAL PICCOLO CONTROLCARD |
| 标准包装： | 1 |
| 系列： | TMS320F2806x, Piccolo™, C2000™ |
| 主要目的： | 接口，RS232，GPIO |
| 嵌入式： | 是，MCU，32 位 |
| 已用 IC / 零件： | TMS320F2806x |
| 已供物品： | 板 |
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C4
C3
XCLKOUT(B)
XCLKIN(A)
C5
C9
C10
C1
C8
C6
SPRS698D – NOVEMBER 2010 – REVISED DECEMBER 2012
5.4
Clock Requirements and Characteristics
Table 5-4. XCLKIN Timing Requirements - PLL Enabled
NO.
MIN
MAX
UNIT
C9
tf(CI)
Fall time, XCLKIN
6
ns
C10
tr(CI)
Rise time, XCLKIN
6
ns
C11
tw(CIL)
Pulse duration, XCLKIN low as a percentage of tc(OSCCLK)
45
55
%
C12
tw(CIH)
Pulse duration, XCLKIN high as a percentage of tc(OSCCLK)
45
55
%
Table 5-5. XCLKIN Timing Requirements - PLL Disabled
NO.
MIN
MAX
UNIT
C9
tf(CI)
Fall time, XCLKIN
Up to 20 MHz
6
ns
20 MHz to 90 MHz
2
C10
tr(CI)
Rise time, XCLKIN
Up to 20 MHz
6
ns
20 MHz to 90 MHz
2
C11
tw(CIL)
Pulse duration, XCLKIN low as a percentage of tc(OSCCLK)
45
55
%
C12
tw(CIH)
Pulse duration, XCLKIN high as a percentage of tc(OSCCLK)
45
55
%
The possible configuration modes are shown in Table 2-17.
Table 5-6. XCLKOUT Switching Characteristics (PLL Bypassed or Enabled)(1)(2)
over recommended operating conditions (unless otherwise noted)
NO.
PARAMETER
MIN
MAX
UNIT
C3
tf(XCO)
Fall time, XCLKOUT
ns
C4
tr(XCO)
Rise time, XCLKOUT
ns
C5
tw(XCOL)
Pulse duration, XCLKOUT low
H – 2
H + 2
ns
C6
tw(XCOH)
Pulse duration, XCLKOUT high
H – 2
H + 2
ns
(1)
A load of 40 pF is assumed for these parameters.
(2)
H = 0.5tc(XCO)
A.
The relationship of XCLKIN to XCLKOUT depends on the divide factor chosen. The waveform relationship shown is
intended to illustrate the timing parameters only and may differ based on actual configuration.
B.
XCLKOUT configured to reflect SYSCLKOUT.
Figure 5-3. Clock Timing
Copyright 2010–2012, Texas Instruments Incorporated
Peripheral and Electrical Specifications
65
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