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参数资料
| 型号： | A1425A-STDCQ132B |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 310 CLBS, 7500 GATES, 100 MHz, CQFP132 |
| 封装： | CERAMIC, QFP-132 |
| 文件页数： | 8/54页 |
| 文件大小： | 343K |
| 代理商： | A1425A-STDCQ132B |
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RadTolerant FPGAs
1- 12
v3.1
Figure 1-6 RT1020, A1020B Timing Model
Notes:
1. *Values shown for RT1280A –1 at worst-case military conditions.
2. Input module predicted routing delay
Figure 1-7 RT1280A, A1280A Timing Model*
tIRD1 = 1.1 ns
tIRD4 = 3.9 ns
tIRD8 = 8.1 ns
tPD = 3.6 ns
tCO = 3.6 ns
Output Delay
Input Delay
I/O Module
Logic Module
I/O Module
ARRAY
CLOCK
Predicted
Routing
Delays
FO = 128
Internal Delays
tRD1 = 1.1 ns
tRD2 = 1.8 ns
tRD4 = 3.9 ns
tRD8 = 8.1 ns
tENHZ = 12.3 ns
tDLH = 8.3 ns
tIRD2 = 1.9 ns
tINYL = 3.9 ns
tCKH = 6.9 ns
FMAX = 55 MHz
t
INYL = 3.6 ns
t
INH = 2.5 ns
t
INSU = 3.5 ns
t
INGL = 6.6 ns
Output Delays
Input Delays
I/O Module
DQ
Internal Delays
Sequential
Logic Module
I/O Module
ARRAY
CLOCKS
DQ
Predicted
Routing
Delays
G
FO = 32
tIRD2 = 7.2 ns
tPD1 = 5.2 ns
tRD1 = 2.4 ns
tRH2 = 3.4 ns
tRD4 = 5.1 ns
tRD8 = 9.2 ns
tDLH = 14.0 ns
FMAX = 73 MHz
tCKH = 13.3 ns
tSUD = 0.5 ns
tHD = 0.0 ns
tCO = 5.2 ns
tRD1 = 2.4 ns
tOUTH = 0.0 ns
tOUTSU = 0.5 ns
tGLH = 12.5 ns
tENHZ = 9.8 ns
Combin-
atorial
Logic
included
in tSUD
Combinatorial
Logic Module
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PDF描述 |
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