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参数资料
| 型号： | 440GP |
| 厂商： | Applied Micro Circuits Corp. |
| 英文描述： | Power PC 440GP Embedded Processor |
| 中文描述： | 440GP的Power PC嵌入式处理器 |
| 文件页数： | 62/83页 |
| 文件大小： | 773K |
| 代理商： | 440GP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页当前第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页
440GP – Power PC 440GP Embedded Processor
AMCC
65
Revision 1.07 – October 4, 2007
Data Sheet
I/O Specifications—All Speeds (Sheet 1 of 4)
Notes:
1. Ethernet interface meets timing requirements as defined by IEEE 802.3 standard.
2. PCI-X timings are for asynchronous operation up to 133MHz. PCI-X input setup time requirement is 1.2ns for 133MHz and
1.7ns for 66MHz. PCI timings (in parentheses) are for asynchronous operation up to 66MHz. PCI output hold time
requirement is 1ns for 66MHz and 2ns for 33MHz.
3. The clock frequency for RMII operation is 50MHz ± 100ppm.
Signal
Input (ns)
Output (ns)
Output Current (mA)
Clock
Notes
Setup Time
(TIS min)
Hold Time
(TIH min)
Valid Delay
(TOV max)
Hold Time
(TOH min)
I/O H
(minimum)
I/O L
(minimum)
PCI-X Interface
PCIXAD00:63
Note 2 (3)
0.5 (0)
3.8 (6)
0.7 (Note 2)
0.5
1.5
PCIXClk
2
PCIXC3:0[BE3:0]
Note 2 (3)
0.5 (0)
3.8 (6)
0.7 (Note 2)
0.5
1.5
PCIXClk
2
PCIXParLow
Note 2 (3)
0.5 (0)
3.8 (6)
0.7 (Note 2)
0.5
1.5
PCIXClk
2
PCIParHigh
Note 2 (3)
0.5 (0)
3.8 (6)
0.7 (Note 2)
0.5
1.5
PCIXClk
2
PCIXFrame
Note 2 (3)
0.5 (0)
3.8 (6)
0.7 (Note 2)
0.5
1.5
PCIXClk
2
PCIXINT
na
dc
0.5
1.5
PCIXClk
async
PCIXIRDY
Note 2 (3)
0.5 (0)
3.8 (6)
0.7 (Note 2)
0.5
1.5
PCIXClk
2
PCIXTRDY
Note 2 (3)
0.5 (0)
3.8 (6)
0.7 (Note 2)
0.5
1.5
PCIXClk
2
PCIXStop
Note 2 (3
0.5 (0)
3.8 (6)
0.7 (Note 2)
0.5
1.5
PCIXClk
2
PCIXDevSel
Note 2 (3)
0.5 (0)
3.8 (6)
0.7 (Note 2)
0.5
1.5
PCIXClk
2
PCIXIDSel
Note 2 (3)
0.5 (0)
na
PCIXClk
2
PCIXPErr
Note 2 (3)
0.5 (0)
3.8 (6)
0.7 (Note 2)
0.5
1.5
PCIXClk
2
PCIXSErr
Note 2 (3)
0.5 (0)
3.8 (6)
0.7 (Note 2)
0.5
1.5
PCIXClk
2
PCIXClk
dc
na
async
PCIXReset
na
PCIXClk
PCIXReq64
Note 2 (3)
0.5 (0)
3.8 (6)
0.7 (Note 2)
0.5
1.5
PCIXClk
2
PCIXAck64
Note 2 (3)
0.5 (0)
3.8 (6)
0.7 (Note 2)
0.5
1.5
PCIXClk
2
PCIXCap
Note 2 (3)
0.5 (0)
na
PCIXClk
2
PCIX133Cap
3.8
0.7
0.5
1.5
PCIXClk
2
PCIXM66En
Note 2 (3)
0.5 (0)
na
PCIXClk
2
PCIXReq0:5
Note 2 (3)
0.5 (0)
na
PCIXClk
2
PCIXGnt0:5
na)
na
3.8 (6)
0.7 (Note 2)
0.5
1.5
PCIXClk
2
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