参数资料
| 型号： | XC6SLX45T-3FG484I |
| 厂商： | Xilinx Inc |
| 文件页数： | 48/89页 |
| 文件大小： | 0K |
| 描述： | IC FPGA SPARTAN 6 484FGGBGA |
| 标准包装： | 60 |
| 系列： | Spartan® 6 LXT |
| LAB/CLB数： | 3411 |
| 逻辑元件/单元数： | 43661 |
| RAM 位总计： | 2138112 |
| 输入/输出数： | 296 |
| 电源电压： | 1.14 V ~ 1.26 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 100°C |
| 封装/外壳： | 484-BBGA |
| 供应商设备封装： | 484-FBGA |
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Spartan-6 FPGA Data Sheet: DC and Switching Characteristics
DS162 (v3.0) October 17, 2011
Product Specification
52
TDSPDCK_OPMODE_PREG/
TDSPCKD_OPMODE_PREG
OPMODE input to P register CLK
Yes
6.21/
–0.84
7.27/
–0.84
7.27/
–0.84
10.43/
–0.84
ns
No
Yes
1.69/
–0.87
1.98/
–0.87
1.98/
–0.87
3.62/
–0.87
ns
No
Yes
2.09/
–0.22
2.30/
–0.22
2.30/
–0.22
3.79/
–0.22
ns
Clock to Out from Output Register Clock to Output Pin
TDSPCKO_P_PREG
CLK (PREG) to P output
N/A
1.20
1.34
1.90
ns
Clock to Out from Pipeline Register Clock to Output Pins
TDSPCKO_P_MREG
CLK (MREG) to P output
N/A
Yes
3.38
3.95
5.83
ns
Clock to Out from Input Register Clock to Output Pins
TDSPCKO_P_A1REG
CLK (A1REG) to P output
N/A
Yes
5.02
5.87
9.65
ns
TDSPCKO_P_B1REG
CLK (B1REG) to P output
N/A
Yes
5.02
5.87
9.63
ns
TDSPCKO_P_CREG
CLK (CREG) to P output
N/A
Yes
3.12
3.64
5.24
ns
TDSPCKO_P_DREG
CLK (DREG) to P output
Yes
6.77
7.92
12.53
ns
Combinatorial Delays from Input Pins to Output Pins
TDSPDO_A_P
A input to P output
N/A
No
Yes
2.85
3.33
4.73
ns
N/A
Yes
No(2)
3.35
3.93
6.74
ns
N/A
Yes
4.56
5.22
8.94
ns
TDSPDO_B_P
B input to P output
Yes
No
No(2)
3.22
3.76
5.55
ns
Yes
No(2)
6.01
6.54
9.76
ns
Yes
6.27
7.34
11.96
ns
TDSPDO_C_P
C input to P output
N/A
Yes
2.69
3.15
4.68
ns
TDSPDO_D_P
D input to P output
Yes
6.31
7.38
11.81
ns
TDSPDO_OPMODE_P
OPMODE input to P output
Yes
6.43
7.52
11.84
ns
No
Yes
4.84
5.66
9.25
ns
No
Yes
3.11
3.49
5.03
ns
Maximum Frequency
FMAX
All registers used
Yes
390
333
213
MHz
Notes:
1.
A Yes signifies that the component is in the path. A No signifies that the component is being bypassed. N/A signifies not applicable because
no path exists.
2.
Implemented in the post-adder by adding to zero.
Table 44: DSP48A1 Switching Characteristics (Cont’d)
Symbol
Description
Pre-
adder
Multiplier
Post-
adder
Speed Grade
Units
-3
-3N
-2
-1L
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PDF描述 |
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| XA6SLX25T-2FGG484Q | IC FPGA SPARTAN 6 484FGGBGA |
相关代理商/技术参数 |
参数描述 |
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