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参数资料
| 型号： | MC8641DVU1333JE |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 70/130页 |
| 文件大小： | 0K |
| 描述： | IC MPU DUAL CORE E600 1023FCCBGA |
| 标准包装： | 1 |
| 系列： | MPC86xx |
| 处理器类型： | 32-位 MPC86xx PowerPC |
| 速度： | 1.333GHz |
| 电压： | 1.05V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 1023-BCBGA，FCCBGA |
| 供应商设备封装： | 1023-FCCBGA（33x33） |
| 包装： | 托盘 |
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MPC8641 and MPC8641D Integrated Host Processor Hardware Specifications, Rev. 2
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Freescale Semiconductor
Ethernet Management Interface Electrical Characteristics
Figure 23 provides the AC test load for eTSEC.
Figure 23. eTSEC AC Test Load
NOTE
Output will see a 50-
Ω load since what it sees is the transmission line.
Figure 24 shows the MII management AC timing diagram.
Figure 24. MII Management Interface Timing Diagram
MDIO to MDC hold time
tMDDXKH
0—
—
ns
—
MDC rise time
tMDCR
—
10
ns
4
MDC fall time
tMDHF
—
10
ns
4
Notes:
1. The symbols used for timing specifications herein follow the pattern of t(first two letters of functional block)(signal)(state)
(reference)(state) for inputs and t(first two letters of functional block)(reference)(state)(signal)(state) for outputs. For example, tMDKHDX
symbolizes management data timing (MD) for the time tMDC from clock reference (K) high (H) until data outputs (D) are
invalid (X) or data hold time. Also, tMDDVKH symbolizes management data timing (MD) with respect to the time data input
signals (D) reach the valid state (V) relative to the tMDC clock reference (K) going to the high (H) state or setup time. For
rise and fall times, the latter convention is used with the appropriate letter: R (rise) or F (fall).
2. This parameter is dependent on the system clock speed. (The maximum frequency is the maximum platform frequency
divided by 64.)
3. This parameter is dependent on the system clock speed. (That is, for a system clock of 267 MHz, the maximum frequency
is 8.3 MHz and the minimum frequency is 1.2 MHz; for a system clock of 375 MHz, the maximum frequency is 11.7 MHz
and the minimum frequency is 1.7 MHz.)
4. Guaranteed by design.
5. tMPXCLK is the platform (MPX) clock
Table 39. MII Management AC Timing Specifications (continued)
At recommended operating conditions with OVDD is 3.3 V ± 5%.
Parameter/Condition
Symbol 1
Min
Typ
Max
Unit
Notes
Output
Z0 = 50 Ω
OVDD/2
RL = 50 Ω
MDC
tMDDXKH
tMDC
tMDCH
tMDCR
tMDCF
tMDDVKH
tMDKHDX
MDIO
(Input)
(Output)
相关PDF资料 |
PDF描述 |
|---|---|
| MC8641DHX1333JE | IC DUAL CORE PROCESSOR 1023-CBGA |
| IDT70V9169L7PF | IC SRAM 144KBIT 7NS 100TQFP |
| XC4028XL-1HQ160C | IC FPGA C-TEMP 3.3V 1SPD 160HQFP |
| XC4028XL-1BG352I | IC FPGA I-TEMP 3.3V 1SPD 352MBGA |
| IDT709359L7PF | IC SRAM 144KBIT 7NS 100TQFP |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MC8641DVU1333K | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Integrated Host Processor Hardware Specifications |
| MC8641DVU1333N | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Integrated Host Processor Hardware Specifications |
| MC8641DVU1500G | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Integrated Host Processor Hardware Specifications |
| MC8641DVU1500H | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Integrated Host Processor Hardware Specifications |
| MC8641DVU1500J | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Integrated Host Processor Hardware Specifications |
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