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参数资料
| 型号： | 37B77X |
| 厂商： | SMSC Corporation |
| 英文描述： | ENHANCED SUPER I/O CONTROLLER WITH WAKE UP FEATURES |
| 中文描述： | 增强型超I / O与向上特征唤醒控制器 |
| 文件页数： | 37/196页 |
| 文件大小： | 573K |
| 代理商： | 37B77X |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页当前第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页
131
CONFIGURATION
The Configuration of the FDC37B77x is very
flexible and is based on the configuration
architecture implemented in typical Plug-and-
Play components. The FDC37B77x is designed
for
motherboard
applications
in
which
the
resources required by their components are
known.
With its flexible resource allocation
architecture, the FDC37B77x allows the BIOS to
assign resources at POST.
SYSTEM ELEMENTS
Primary Configuration Address Decoder
After a hard reset (RESET_DRV pin asserted) or
Vcc Power On Reset the FDC37B77x is in the
Run Mode with all logical devices disabled. The
logical devices may be configured through two
standard Configuration I/O Ports
(INDEX and
DATA)
by
placing
the
FDC37B77x
into
Configuration Mode.
The BIOS uses these
configuration
ports
to
initialize
the
logical
devices at POST. The INDEX and DATA ports
are only valid when the FDC37B77x is in
Configuration Mode.
The SYSOPT pin is latched on the falling edge
of the RESET_DRV or on Vcc Power On Reset
to determine the configuration register's base
address. The SYSOPT pin is used to select the
CONFIG PORT's I/O address at power-up.
Once powered up the configuration port base
address can be changed through configuration
registers CR26 and CR27. The SYSOPT pin is
a hardware configuration pin which is shared
with the nRTS1 signal on pin 87. During reset
this pin is a weak active low signal which sinks
30A. Note: All I/O addresses are qualified with
AEN.
The INDEX and DATA ports are effective only
when the chip is in the Configuration State.
PORT NAME
SYSOPT= 0
PULL-DOWN RESISTOR
(NOTE 1)
SYSOPT= 1
10K PULL-UP
RESISTOR
TYPE
CONFIG PORT (Note
2)
0x03F0
0x0370
Write
INDEX PORT (Note 2)
0x03F0
0x0370
Read/Write
DATA PORT
INDEX PORT + 1
Read/Write
Note 1:
If using TTL RS232 drivers use 1K pull-down. If using CMOS RS232 drivers use
10K pull-down.
Note 2:
The configuration port base address can be relocated through CR26 and CR27.
Entering the Configuration State
The device enters the Configuration State when
the following Config Key is successfully written
to the CONFIG PORT.
Config Key = < 0x55 >
Exiting the Configuration State
The device exits the Configuration State when
the following Config Key is successfully written
to the CONFIG PORT.
Config Key = < 0xAA>
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