参数资料
| 型号： | XC4013E-2HQ240I |
| 厂商： | Xilinx Inc |
| 文件页数： | 2/68页 |
| 文件大小： | 0K |
| 描述： | IC FPGA I-TEMP 5V 2SPD 240-HQFP |
| 产品变化通告： | XC1700 PROMs,XC5200,HQ,SCD Parts Discontinuation 19/Jul/2010 |
| 标准包装： | 1 |
| 系列： | XC4000E/X |
| LAB/CLB数： | 576 |
| 逻辑元件/单元数： | 1368 |
| RAM 位总计： | 18432 |
| 输入/输出数： | 192 |
| 门数： | 13000 |
| 电源电压： | 4.5 V ~ 5.5 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 100°C |
| 封装/外壳： | 240-BFQFP 裸露焊盘 |
| 供应商设备封装： | 240-PQFP（32x32） |
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R
XC4000E and XC4000X Series Field Programmable Gate Arrays
6-14
May 14, 1999 (Version 1.6)
G'
4
G1 G4
F1 F4
C1 C4
WRITE
DECODER
1 of 16
DIN
16-LATCH
ARRAY
X6752
4
MUX
F'
WRITE
DECODER
1 of 16
DIN
16-LATCH
ARRAY
READ
ADDRESS
READ
ADDRESS
WRITE PULSE
LATCH
ENABLE
LATCH
ENABLE
K
(CLOCK)
WE
D1
D0
EC
WRITE PULSE
MUX
4
Figure 4:
16x2 (or 16x1) Edge-Triggered Single-Port RAM
G'
4
G1 G4
F1 F4
C1 C4
WRITE
DECODER
1 of 16
DIN
16-LATCH
ARRAY
X6754
4
MUX
F'
WRITE
DECODER
1 of 16
DIN
16-LATCH
ARRAY
READ
ADDRESS
READ
ADDRESS
WRITE PULSE
LATCH
ENABLE
LATCH
ENABLE
K
(CLOCK)
WE
D1/A4
D0
EC
WRITE PULSE
MUX
4
H'
Figure 5: 32x1 Edge-Triggered Single-Port RAM (F and G addresses are identical)
Product Obsolete or Under Obsolescence
相关PDF资料 |
PDF描述 |
|---|---|
| 65801-024LF | CLINCHER RECEPTACLE ASSY 24TIN |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| XC4013E-2HQ240M | 制造商:XILINX 制造商全称:XILINX 功能描述:XC4000E and XC4000X Series Field Programmable Gate Arrays |
| XC4013E-2MQ240C | 制造商:XILINX 制造商全称:XILINX 功能描述:Programmable Gate Arrays |
| XC4013E-2MQ240I | 制造商:XILINX 制造商全称:XILINX 功能描述:Programmable Gate Arrays |
| XC4013E-2MQ240M | 制造商:XILINX 制造商全称:XILINX 功能描述:Programmable Gate Arrays |
| XC4013E-2PC240C | 制造商:XILINX 制造商全称:XILINX 功能描述:Programmable Gate Arrays |
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