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参数资料
| 型号： | LT3510IFE#PBF |
| 厂商： | Linear Technology |
| 文件页数： | 9/30页 |
| 文件大小： | 0K |
| 描述： | IC REG BUCK ADJ 2A DL 20TSSOP |
| 标准包装： | 74 |
| 类型： | 降压（降压） |
| 输出类型： | 可调式 |
| 输出数： | 2 |
| 输出电压： | 0.8 V ~ 23.8 V |
| 输入电压： | 3.1 V ~ 25 V |
| PWM 型： | 电流模式 |
| 频率 - 开关： | 250kHz ~ 1.5MHz |
| 电流 - 输出： | 2A |
| 同步整流器： | 无 |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-TSSOP（0.173"，4.40mm 宽）裸露焊盘 |
| 包装： | 管件 |
| 供应商设备封装： | 20-TSSOP-EP |
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LT3510
PIN FUNCTIONS
the clock signal is detected, with switch 1 in phase with
the synchronization signal. Each rising clock edge initiates
an oscillator ramp reset. A gain control loop servos the
oscillator charging current to maintain a constant oscillator
amplitude. Hence, the slope compensation and channel
phase relationship remain unchanged. If the clock signal
is removed, the oscillator reverts to resistor mode and
reapplies the 0.975V bias to the R T /SYNC pin after the
synchronization detection circuitry times out. The clock
source impedance should be set such that the current out
of the R T /SYNC pin in resistor mode generates a frequency
roughly equivalent to the synchronization frequency.
BST1/BST2 (Pins 20, 11): The BST pin provides a higher
than V IN base drive to the power NPN to ensure a low
switch drop. A comparator to V IN imposes a minimum
off time on the SW pin if the BST pin voltage drops too
low. Forcing a SW off time allows the boost capacitor to
recharge.
Exposed Pad (Pin 21): GND. The Exposed Pad GND pin is
the only ground connection for the device. The Exposed
Pad should be soldered to a large copper area to reduce
thermal resistance. The GND pin is common to both chan-
nels and also serves as small-signal ground. For ideal
operation all small-signal ground paths should connect
to the GND pin at a single point, avoiding any high current
ground returns.
3510fe
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参数描述 |
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