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参数资料
| 型号： | ADZS-BFAV-EZEXT |
| 厂商： | Analog Devices Inc |
| 文件页数： | 34/60页 |
| 文件大小： | 0K |
| 描述： | BOARD DAUGHT ADSP-BF533,37,61KIT |
| 产品培训模块： | Interfacing AV Converters to Blackfin Processors |
| 标准包装： | 1 |
| 附件类型： | DSP |
| 适用于相关产品： | ADSP-BF533，ADSP-BF537，ADSP-BF538，ADSP-BF561 EZLITE Kits |
| 相关产品： | ADSP-BF537KBCZ-6BV-ND - IC DSP CTLR 16BIT 208CSPBGA ADSP-BF537BBCZ-5BV-ND - IC DSP CTLR 16BIT 208CSPBGA ADSP-BF537KBCZ-6AV-ND - IC DSP CTLR 16BIT 182CSPBGA ADSP-BF537BBCZ-5AV-ND - IC DSP CTLR 16BIT 182CSPBGA ADSP-BF561SKBCZ-6V-ND - IC DSP 32BIT 600MHZ 256CSPBGA ADSP-BF561SKBCZ-5V-ND - IC DSP 32BIT 500MHZ 256CSPBGA ADSP-BF533SBBC400-ND - IC PROCESSOR 400MHZ 160-CSPBGA ADSP-BF533SBBCZ400-ND - IC PROCESSOR DL 400MHZ 160CSPBGA ADSP-BF561SKBCZ-5A-ND - IC DSP CTLR 32BIT BKFN 256CSPBGA ADSP-BF533SKBC-6V-ND - IC DSP CTLR DUAL 160CSPBGA 更多... |
| 其它名称： | ADDS-BFAV-EZEXT ADDS-BFAV-EZEXT-ND |
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Jumpers
Encoder HREF Connection Jumper (JP3.15/16)
To connect the horizontal sync signal of the video encoder to the PPI0
frame sync signal of the processor, install the JP3.15/16 jumper; other-
wise, the encoder’s horizontal reference is disconnected.
Encoder VSYNC Connection Jumper (JP3.17/18)
To connect the vertical sync signal of the video encoder to the PPI0 frame
sync signal of the processor, install the JP3.17/18 jumper; otherwise, the
encoder’s vertical sync is disconnected.
Decoder Output Enable Jumper (JP3.19/20)
When installed, the JP3.19/20 jumper enables the video decoder’s data
output signals on the VID_IN bus.
SNAPSHOT_FODD Disconnect Jumper (JP3.21/22)
The SNAPSHOT_FODD net of the A-V EZ-Extender is a general-purpose flag
pin. The flag pin connects to both the SNAPSHOT signal of the Kodak cam-
era evaluation board and the FODD control signal of the OmniVision
camera evaluation board. Do not install the jumper unless the processor
needs to control the signals. The flag pin also connects to the SPI select
pin of the AD1836A audio codec—do not install this jumper when the
audio interfaces is in use.
PPI Clock Setup Jumpers (JP4.1/2, JP4.3/4, JP4.5/6,
JP4.7/8)
The PPI_CLK signals of the PPI0 and PPI1 are set up using the clock setup
jumpers. Table 2-5 shows the results of the jumper connections. For more
information about the clock settings, refer to Figure 2-1 on page 2-4 .
2-10
Blackfin A-V EZ-Extender Manual
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PDF描述 |
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参数描述 |
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